本帖最后由 仗剑天涯 于 2023-12-4 14:44 编辑
难题名称
难题介绍 功耗问题是当前电路设计中的一个关键问题，对于如今的移动设备或者需要控制温度的高性能设备至关重要。时钟门控（clock gating）是降低动态功耗的最有效的技术之一。当设计中的某些模块在进行无效计算时，使相应的时钟失效，不仅可以降低时钟树的功耗，也可以降低模块本身的功耗。时钟门控技术的实现依靠电路网表中 “时钟门控条件（clock gating condition）” 的提取，一个质量好的时钟门控条件，既可以保证功耗优化的效果，又能做到不过度提升电路的复杂度。传统的时钟门控条件提取主要是基于结构化方法，本赛题提倡参赛者使用形式化分析的方法计算该条件。为了简化赛题，本赛题无需用 retiming 将 DFF 的 Q 端门控条件推到 D 端，最终判题只考虑 DFF 的 Q 端。
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命题企业
难题Chair 曹皖林，现任合见工业软件集团 Fellow。Texas A&M 大学计算机科学博士，清华大学计算机软件硕士、学士，具有二十多年硅谷公司工作经验，曾经参加国家七五计划重点项目“熊猫 ICCAD 系统”研发。研究兴趣包括形式化方法及其应用，EDA 与 FPGA 工具开发等。
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